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| 2010-12-23 | IIC-China 2011展前专访：芯科实验室有限公司 Silicon Laboratories产品包括高性能混合信号MCU、红外传感器、卫星机顶盒接收器、调频广播收发器/接收器/发射器、卫星广播调谐器、调制解调器、VCXO和XO、时钟和数据恢复芯片、精密时钟芯片。 |
| 2010-10-28 | Hittite发布频率合成器模块产品HMC-C083 Hittite微波公司于日前推出HMC856LC5，这是一款具有5位数字控制，面向定时补偿和时钟脉冲相位差处理应用的宽频带时延产品，输出电压可编程控制，非常适合于宽频带测试测量、基于SONET OC-192的系统、时钟数据恢复、频率合成、定时补偿等应用。 |
| 2010-10-28 | Hittite推出频率合成器模块产品HMC-C083 Hittite微波公司于日前推出HMC856LC5，这是一款具有5位数字控制，面向定时补偿和时钟脉冲相位差处理应用的宽频带时延产品，输出电压可编程控制，非常适合于宽频带测试测量、基于SONET OC-192的系统、时钟数据恢复、频率合成、定时补偿等应用。 |
| 2010-10-28 | Hittite推出HMC856LC5，扩展其宽带时延产品线 Hittite微波公司于日前推出HMC856LC5，这是一款具有5位数字控制，面向定时补偿和时钟脉冲相位差处理应用的宽频带时延产品，输出电压可编程控制，非常适合于宽频带测试测量、基于SONET OC-192的系统、时钟数据恢复、频率合成、定时补偿等应用。 |
| 2010-09-25 | Hittite发布10GHz窗口比较器HMC974LC3C Hittite公司首次全新发布HMC974LC3C——一个9mm2SMT封装上的10GHz的窗口比较器。HMC974LC3C窗口比较器突出了低过载和小转换速率离散、低随机抖动和低功耗特性，一举使它成为在包括时钟和数据恢复、通讯、ATE、半导体测试系统，高速触发和EW系统的广泛的应用中的理想方案。 |
| 2010-08-17 | Hittite全新10GHz窗口比较器HMC974LC3C HMC974LC3C窗口比较器突出了低过载和小转换速率离散、低随机抖动和低功耗特性，一举使它成为在包括时钟和数据恢复、通讯、ATE、半导体测试系统，高速触发和EW系统的广泛的应用中的理想方案。 |
| 2008-12-15 | Vitesse推出CDR收发器VSC3406 瞄准高清晰视频广播设备应用 Vitesse半导体公司将其最新的时钟及数据恢复(CDR)收发器VSC3406瞄准高清晰视频广播设备这一领域。未经压缩的、高清晰(HD)、SMPTE(电影和电视工程师协会)、1080i/1080p信号数据在通过电缆、连接器和背板时会失真，VSC3406可显著改善此类信号的完整性。 |
| 2008-12-15 | Vitesse发布CDR收发器VSC3406，面向高清晰视频广播设备应用 Vitesse半导体公司将其最新的时钟及数据恢复(CDR)收发器VSC3406瞄准高清晰视频广播设备这一领域。未经压缩的、高清晰(HD)、SMPTE(电影和电视工程师协会)、1080i/1080p信号数据在通过电缆、连接器和背板时会失真，VSC3406可显著改善此类信号的完整性。 |
| 2008-12-12 | Vitesse瞄准高清晰视频广播设备应用的CDR收发器VSC3406 Vitesse半导体公司将其最新的时钟及数据恢复(CDR)收发器VSC3406瞄准高清晰视频广播设备这一领域。未经压缩的、高清晰(HD)、SMPTE(电影和电视工程师协会)、1080i/1080p信号数据在通过电缆、连接器和背板时会失真，VSC3406可显著改善此类信号的完整性。 |
| 2008-12-12 | Vitesse推出可用于远程监控的CDR收发器VSC3406 Vitesse半导体公司将其最新的时钟及数据恢复(CDR)收发器VSC3406瞄准高清晰视频广播设备这一领域。未经压缩的、高清晰(HD)、SMPTE(电影和电视工程师协会)、1080i/1080p信号数据在通过电缆、连接器和背板时会失真，VSC3406可显著改善此类信号的完整性。 |
| 2007-12-31 | 高级SERDES IO模型的建模与互用性 系统设计公司为减少开发高级PCB系统的成本与时间并提高生产力，要求IC公司开发高级SERDES IO架构。该架构包括前馈均衡器、判决反馈均衡器和时钟及数据恢复电路，使用当前的建模标准对它们进行建模将非常困难甚至不可能。为确保板级串行链路设计，系统设计公司必须模拟带有SERDES收发器模型的串行链路，以降低成本并缩短设计周期。 |
| 2007-12-21 | 用FPGA构建PCI Express端点器件的最佳平台 在选择一种技术来实现PCI Express设计之前，必须仔细考虑应用的IP选择、链路效率、兼容性测试及资源可用性。本文中，我们将简要介绍使用最新的FPGA技术构建单芯片x4和x8通道PCI Express设计的一些因素。 |
| 2007-03-07 | 富士通快速时钟数据恢复IC揭开神秘面纱 富士通快速时钟数据恢复IC揭开神秘面纱 |
| 2006-05-18 | 安捷伦科技公司在其J-BERT分析仪中集成新的CDR 安捷伦科技公司日前宣布，推出业内首款内置的、可调谐环路带宽时钟数据恢复选件(CDR)，为其屡获殊荣的J-BERT N4903A高性能BERT提供了符合CDR设置的一致性测试程序库。CDR采用了当今的串行千兆位总线标准 |
| 2006-05-15 | ADI四款最新时钟和数据恢复IC提供低抖动性能以简化光网络设计 ADI四款最新时钟和数据恢复IC提供低抖动性能以简化光网络设计 |
| 2006-01-12 | AMCC推出具有时钟和数据恢复的收发器 AMCC推出具有时钟和数据恢复的收发器 |
| 2005-04-24 | 把高速串行收发器集成到FPGA中的挑战 业界对串行标准和协议(如PCI Express、串行Rapid I/O和SerialLite)的广泛接受将促使人们更多地使用带有CDR(时钟和数据恢复)模块的高速串行收发器。这些过去以4通道或8通道专用标准产品(ASSP)实现的收发器现在被集成到高端FPGA中。带嵌入式收发器的FPGA具有更高的灵活性，可以减小板空间，并避免了双芯片方案的接口问题，因而成为对电路板设计者有吸引力的一种解决方案。 |
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