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EDA/IP/IC设计

通过电路板版图分析来降低抖动

作者: Gene Garat, Technical Marketing Engineer, Mentor Graphics Corp. 上网日期: 2004年10月15日

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关键字： jitter deterministic jitter crosstalk effective dielectric constant fringe field

[摘要提示] 大部分高速数字产品都使用时钟来进行系统定时同步，在一个时钟周期中必须完成一系列操作，包括一个逻辑深度内的所有门切换时延、芯片内部以及芯片之间的传播时延、互连引起的上升时间或充电时延、建立和保持时间，以及时钟与数据线之间的偏差等等。定时预算负责给每个时延源分配时间。本文介绍在满足功能要求的前提下，如何解决高速数字设计产品中定时预......

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