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如何快速设计出高效可靠的同步降压稳压器?

时间:2017-06-19 阅读:
为满足行业高能效、高可靠性和高功率密度的设计趋势,在进行同步降压稳压器的设计时,需从动态性能、能效设计等方面综合考虑。通过仔细调整元器件值,能够相对容易地实现优化的动态性能,但处理和优化MOSFET功耗的技术通常较为繁琐复杂。
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同步降压稳压器是一种常用的电源 ,随着各类应用要求的不断提高,行业越来越趋向于追求高能效、高可靠性、高功率密度的设计方案。比如 应用于无线局域网的负载点(PoL)电源,输入电压越来越宽,工作频率、功率密度也越来越高,随着技术的发展,甚至可将整个电源系统集成在单个封装中。同步降压稳压器其电路结构本身非常简单, 但工程师要完成高效可靠的同步降压稳压器的设计,还是有着不少的技术挑战,必须对稳压器电路的各种工作状态有着非常深入、透彻的了解,同时还需完成大量的计算工作。本文将介绍快速设计出高效可靠的同步降压稳压器的技术, 以及安森美半导体的 Power Supply WebDesigner在线设计工具,幇助工程师解决所面临的技术挑战。flHEETC-电子工程专辑

动态性能的设计

设计一个可靠的同步降压稳压器,首先必须满足其动态性能指标如负载响应能力。而输出电感、电容的选择会直接影响到稳压器的动态性能,所以同步降压稳压器的功率电路设计通常是从选择输出电感和电容开始。flHEETC-电子工程专辑

1、选择电感flHEETC-电子工程专辑

从电路设计的角度,为实现快速瞬态响应, 必须选择尽可能小的输出滤波电感和最小的输出电容。然而小的电感值会增加电感电流纹波,导致电感中有效电流值增加而使得导通损耗增大,同时所导致的峰值电流的增加,也会大大增加控制管的开关损耗。flHEETC-电子工程专辑

使用大电感,可减小电感中的电流纹波,从而降低稳态输出电压纹波,所导致的低峰值电流也有助于降低MOSFET的开关损耗,但电感太大不仅会导致相对较大的直流阻抗,产生较高的电感损耗,还会降低稳压器的负载响应能力,从而降低稳压器的动态性能。
为选择适当的电感,通常可假定电流纹波ΔILO为电感平均电流的30%,然后根据下面的公式直接计算出合适的电感值。flHEETC-电子工程专辑

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2、选择电容flHEETC-电子工程专辑

最小输出电容的选择必须考虑到两个因素:一是稳态下输出电压纹波的要求,二是当负载从满载到空载突变时所允许的最大输出过冲电压。
但输出电容也不是越大越好,太大的输出电容及电容本身的寄生串联电阻会影响到稳压器的输出电路的性能以及当负载突变时稳压器的瞬态响应能力。flHEETC-电子工程专辑

通常,输出电容应首选: 一,有较小等效串联电阻(ESR)的电容, 以便降低交流损耗和输出纹波; 二, 有较小等效串联电感(ESL)的电容, 以便在负载突变时抑制输出偏差。flHEETC-电子工程专辑

能效设计

作为控制管和同步整流开关, 功率MOSFET广泛用于降压稳压器中。它们消耗大部分的损耗功率,通常决定了稳压器的整体能效。flHEETC-电子工程专辑

1、选择最佳的MOSFETflHEETC-电子工程专辑

针对不同的设计要求,比如是想要成本最低,还是想要损耗最低,又或是想要封装尽可能小等等,需要选择不同的MOSFET。flHEETC-电子工程专辑

考虑到额定电流通常与MOSFET成本成正比,有的工程师会根据额定电流的大小来选择MOSFET,希望以此来控制产品成本;为最大限度地降低导通损耗,有的工程师则会选择具有最低RDS(ON)的MOSFET;还有的根据质量因数(FOM)= RDS(ON)xQg(TOT)来进行选择,希望能平衡导通损耗和开关损耗……这些依赖于参数的选择方法其实都有不足。使用额定电流及电压的方法没有考虑具体的开关损耗;而最低RDS(ON)法,成本可能会佷高,且MOSFET寄生电容可能导致更低的能效; FOM法则不能预测能效或成本。flHEETC-电子工程专辑

因此,无论是为了降低成本,提高能效,还是为了设计更紧凑的产品,必须完整计算出电路损耗及工作温度,才能确保设计出的产品能工作在可靠的工作温度范围,达到最佳的能效。flHEETC-电子工程专辑

2、计算MOSFET的损耗flHEETC-电子工程专辑

在计算损耗前,需要先了解MOSFET在同步降压稳压器中的工作机制。图1所示为简化的稳压器的功率电路原理图,其中Q1为控制管,Q2 为同步管。flHEETC-电子工程专辑

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图1:简化的稳压器的功率电路原理图flHEETC-电子工程专辑

同步降压稳压器主要有3种工作状态,其开关顺序是A-B-C-B-A,如图2所示。flHEETC-电子工程专辑

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图2:同步降压稳压器的开关顺序flHEETC-电子工程专辑

状态A:控制管导通,输入电流经过控制管、电感传送到输出端。flHEETC-电子工程专辑

状态B:控制管和同步管同时关断,电感储能通过同步管的寄生二极管放电,传送到输出端。flHEETC-电子工程专辑

状态C:同步管导通,电感储能通过同步管放电,传送到输出端。flHEETC-电子工程专辑

MOSFET的功耗包括控制管和同步管的导通损耗(PCOND)、控制管的开关损耗PSW、同步管的开关损耗、控制管和同步管的栅极驱动损耗PRgate。在140 kHz频率下导通损耗几乎占总功耗的70%。随着频率升高,总功耗中逐渐以开关损耗(PSW)为主。flHEETC-电子工程专辑

1). 控制管Q1的损耗计算flHEETC-电子工程专辑

Q1工作在硬开关条件下,在小占空比或高频(> MHz)时以开关损耗为主,开关性能受同步管Q2影响:快速di/dt可导致反向恢复损耗增加,快速dv/dt有可能引起Q2误导通, 造成Q1、Q2直通现象,导致额外的损耗。另外,值得注意的是,由Q2体二极管导致的反向恢复损耗、 Q2输出电容导致的输出电容损耗主要耗散于控制管Q1上 [Ref. 1,2]。因此,在计算Q1的开关损耗和温度时必须综合考虑到Q2的影响。另外,Q1的导通阻抗随结温上升而上升。结温越高,导通阻抗越高,导通损耗就越高, 使得结温进一步上升。因此,对Q1的导通损耗必须循环反复计算,直到管子的温度计算结果稳定下来。flHEETC-电子工程专辑

对于高频应用(>MHz),控制管Q1的选用应针对降低开关损耗进行优化。Q1损耗的计算公式如下:flHEETC-电子工程专辑

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Q1的导通损耗PCOND随输入电压(VIN)增加而降低,开关损耗PSW随VIN增加而增加,栅极驱动损耗PRgate与VIN无关。当VIN为最大或最小时,Q1的总损耗最大。flHEETC-电子工程专辑

2). 同步管Q2的损耗计算flHEETC-电子工程专辑

Q2工作在零电压开关(ZVS)条件下,当Fsw<1.5 MHz时通常以导通损耗为主。在选择Q2时,建议选用:flHEETC-电子工程专辑

 具有低FOM(低Rds_on x Qgs)的MOSFET,以降低Q2的总损耗

 低Qgd/Qgs 比率(<1)以防止快速dv/dt引起 Q1、Q2的直通现象

 对于高频应用,选用集成肖特基体二极管的MOSFET,以降低反向恢复损耗以及二极管导通损耗
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Q2的损耗计算公式如下:flHEETC-电子工程专辑

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Q2的导通损耗PCOND随VIN升高而增加,开关损耗PSW只是随着VIN升高而略微增加。而Q2的寄生二极管导通损耗PDcond和栅极驱动损耗PRgate都与VIN无关。因此,当VIN为最大时,Q2损耗最大。flHEETC-电子工程专辑

综上所述,当VIN为最大或最小时,Q1 + Q2总的损耗最大。进行计算时,必须同时考虑Q1和Q2的相互影响。flHEETC-电子工程专辑

设计示例

以下通过一个设计示例, 演示如何完成控制管Q1和同步管Q2的 优化选择。如果要设计一个输出为5 V、10 A的同步降压稳压器,其输入电压VIN=8---16V,工作频率FSW= 350kHz。考虑到20%的安全裕量及开关节点的电压振荡,可初步选择额定电压30 V以上、额定电流IDCONT额定值≥ 10.3 A的MOSFET。然后,根据具体的应用要求,确定MOSFET的封装要求。为简化演示,我们选择采用5x6 mm PQFN (Power 56) 封装的器件。综合以上选择条件,安森美半导体的产品阵容中有超过150个器件供选择,我们需再进一步从中挑选出合适的Q1和Q2。同样为简化演示,我们将列出用于Q1和Q2的各12个器件。flHEETC-电子工程专辑

对于Q2,VIN= VINMAX时损耗最大。图3所示的12个器件中,FDMS7656AS有最低的最大损耗。但由于Q2 寄生参数会影响Q1的 开关损耗, 最小Q2 损耗通常并不意味着最佳的总能效。必须比较Q1及Q2的总功耗来找到最佳的Q2以实现最高能效。flHEETC-电子工程专辑

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图3:Q2的损耗对比flHEETC-电子工程专辑

对于Q1,VIN= VINMAX或VINMIN时损耗最大。图4所示的12个器件中,FDMS8027S和FDMS8023S分别在VIN= VINMAX和VINMIN时有最低的最大损耗的Q1。flHEETC-电子工程专辑

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图4:Q1的损耗对比flHEETC-电子工程专辑

为优化转换器能效,首先根据VIN选择损耗最小的Q1,然后选择产生损耗最小的Q2。本例中, 无论VIN最小或最大,最佳的Q2是相同的,都为FDMS7658AS(但并不总是如此,特别是具有宽VIN范围或高FSW时)。flHEETC-电子工程专辑

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图5:优化组合Q1和Q2flHEETC-电子工程专辑

由于当VIN=VINMAX或VINMIN,Q1 + Q2总的损耗最大,我们需对总的损耗进行对比,选择最大损耗最低的最佳组合。如图6所示,选用FDMS8027S为Q1,FDMS7658AS为Q2时,Q1+Q2的最大损耗最低。flHEETC-电子工程专辑

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图6:Q1和Q2总的损耗对比flHEETC-电子工程专辑

快速设计高效可靠的同步降压稳压器的工具:Power Supply WebDesigner

上述设计示例表明,在设计同步降压稳压器时,为选择最佳的Q1和Q2需进行大量繁琐复杂的计算。为帮助工程师快速完成高效可靠的设计,安森美半导体提供了强大的在线设计平台Power Supply WebDesigner ,加速FET优化。flHEETC-电子工程专辑

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图7:Power Supply WebDesigner 在线设计平台flHEETC-电子工程专辑

通过Power Supply WebDesigner里的SynchronousBuck功率回路损耗分析工具Power Train Loss,工程师可轻松对比合格MOSFET器件的数据及性能,自动排除超过TJ 限制的器件,选择设计裕量和工作温度范围,选择单个或双重封装的MOSFET,根据额定电压、电流或封装筛选器件,添加并联器件和栅极阻尼电阻, 立即计算出不同的Q1 + Q2 组合的损耗,。在完成选定Q1和Q2后,工程师可获得输入电压笵围和负载笵围内功率回路的各类损耗和能效曲线,并根据各类曲线和功率回路能效汇总表针对不同的设计进行完整的分析、比较 (图8]。最后,Power Supply WebDesigner可提供PNG格式的电路原理图、Excel格式的器件清单、完整的PDF设计报告,工程师可在线保存,便于以后参考或修改。flHEETC-电子工程专辑

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图8:SynchronousBuck功率回路损耗分析工具应用flHEETC-电子工程专辑

总结

为满足行业高能效、高可靠性和高功率密度的设计趋势,在进行同步降压稳压器的设计时,需从动态性能、能效设计等方面综合考虑。通过仔细调整元器件值,能够相对容易地实现优化的动态性能,但处理和优化MOSFET功耗的技术通常较为繁琐复杂。安森美半导体的Power Supply WebDesigner可帮助简化设计流程,加速MOSFET优化选择。flHEETC-电子工程专辑

*[1]: Understanding Diode Reverse Recovery and its Effect on Switching Losses. Fairchild Power Seminar 2007. Fairchild now is part of On SemiconductorflHEETC-电子工程专辑

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